- Cadence Concept-HDL & Allegro原理圖與電路板設(shè)計(第2版)
- 周潤景 李茂泉編著
- 281字
- 2021-07-23 18:11:33
3.7 運行規(guī)則檢驗(Rules Checker)
本節(jié)使用檢驗程序來檢查原理圖中的錯誤。
(1)在項目管理器窗口,選擇Tools→Rules Checker,如圖3-7-1所示,打開Rules Checker對話框。
(2)選擇loading_io_checks.rle規(guī)則設(shè)置,檢查網(wǎng)絡(luò)的輸入和輸出引腳。如果有下列情況會報錯:沒有輸出或者雙向引腳;沒有輸入或者雙向引腳;僅有一個雙向引腳。
(3)選擇net_name_checks.rle規(guī)則設(shè)置并單擊Run按鈕,如圖3-7-2所示,布圖規(guī)則檢驗報告會給出設(shè)計中的錯誤。單擊OK按鈕關(guān)閉錯誤提示窗口。

圖3-7-1 菜單欄

圖3-7-2 設(shè)置檢驗規(guī)則
(4)查看報告,單擊View Files,選擇cp.msg文件并單擊OK按鈕,可以看到所有在設(shè)計中的網(wǎng)絡(luò)都缺少輸出引腳。這些問題將在后續(xù)內(nèi)容中解決。
(5)退出報告,在布圖規(guī)則檢驗窗口,選擇File→Exit。
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