- FPGA從入門到精通(實(shí)戰(zhàn)篇)
- 至芯科技教研組
- 486字
- 2021-02-26 11:46:04
2.4 縮減運(yùn)算符實(shí)戰(zhàn)演練
縮減運(yùn)算符是單目運(yùn)算符,可進(jìn)行 “與” 或 “非” 運(yùn)算。利用縮減運(yùn)算符進(jìn)行 “與” 或“非” 運(yùn)算的規(guī)則類似于位運(yùn)算符的 “與” 或 “非” 運(yùn)算的規(guī)則,但兩者的運(yùn)算過(guò)程不同。
● 位運(yùn)算符是對(duì)操作數(shù)的相應(yīng)位進(jìn)行 “與” 或 “非” 運(yùn)算,操作數(shù)是幾位數(shù),運(yùn)算結(jié)果也是幾位數(shù)。
● 縮減運(yùn)算符是對(duì)單個(gè)操作數(shù)進(jìn)行 “與” 或 “非” 的遞推運(yùn)算,最后的運(yùn)算結(jié)果是一個(gè)二進(jìn)制數(shù)。
縮減運(yùn)算符的具體應(yīng)用過(guò)程如下:
將操作數(shù)的第一位與第二位進(jìn)行 “與” 或 “非” 運(yùn)算。
將上一步的運(yùn)算結(jié)果與第三位進(jìn)行 “與” 或 “非” 運(yùn)算,依次類推,直到最后一位。
應(yīng)用縮減運(yùn)算符的示意代碼如下:

以上代碼相當(dāng)于如下語(yǔ)句:

下面小芯將編寫一個(gè)實(shí)例,通過(guò)仿真波形來(lái)驗(yàn)證運(yùn)算結(jié)果。縮減運(yùn)算符的應(yīng)用代碼如下。


編寫縮減運(yùn)算符的測(cè)試代碼,如下所示。

得到的仿真波形如圖2.7 所示。

圖2.7
通過(guò)該波形可以看出,當(dāng)變量B 的4 位全為1(高電平)時(shí),通過(guò)執(zhí)行 “與” 運(yùn)算,最終輸出的變量C 為高電平。如果在變量B 中加入0,其執(zhí)行結(jié)果如何呢?在這種情況下,得到的仿真波形如圖2.8 所示。

圖2.8
從圖2.8 可以看到,如果變量B 中存在0,那么輸出的變量C 因執(zhí)行 “與” 運(yùn)算,最終會(huì)得到低電平。
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